|
รายละเอียดสินค้า:
|
| แบนด์วิดธ์: | 40 เมกะเฮิรตซ์ | ช่วงความถี่: | 10MHz-6GHz |
|---|---|---|---|
| FPGA: | XC7K410T | กระดานลูกสาว: | UBX-LW 40MHZ |
| GPSDO: | ไม่อยู่ข้างใน | อินเตอร์เฟซ: | พอร์ต 1/10 กิกะบิต PCIE |
| แสงสูง: | USRP 2944 160MHz,160MHz 2944 USRP,2944 USRP 160MHz |
||
Luowave USRP 2944
USRP-LW 2944 เป็นแพลตฟอร์มวิทยุที่กำหนดโดยซอฟต์แวร์ (SDR) ประสิทธิภาพสูงและปรับขนาดได้สำหรับการออกแบบและปรับใช้ระบบสื่อสารไร้สายยุคหน้าประกอบด้วยบอร์ด USRP-LW X310 หนึ่งตัวและบอร์ดลูก RF UBX-LW 40MHz RF สองตัว
สถาปัตยกรรมฮาร์ดแวร์ USRP-LW 2944 รวมสล็อตบอร์ดลูกแบนด์วิดท์ขยายสองช่องที่มีแบนด์วิดท์สูงถึง 40M จาก 10MHz ถึง 6GHzและมีอินเทอร์เฟซความเร็วสูงหลายแบบให้เลือก (PCIe, พอร์ต Gigabit/10 Gigabit Ethernet) รวมถึง Kintex-7 FPGA ที่ผู้ใช้ตั้งโปรแกรมได้มากมายนอกจากนี้USRP-LW 2944ใช้ไดรเวอร์ UHD ข้ามแพลตฟอร์มแบบโอเพ่นซอร์ส พร้อมเฟรมเวิร์กการพัฒนาจำนวนมาก สถาปัตยกรรมอ้างอิงที่เข้ากันได้ และโปรเจ็กต์โอเพ่นซอร์ส
เนื่องจากเป็นแกนประมวลผลดิจิทัลของ USRP-LW 2944 XC7K410T FPGA จึงให้การเชื่อมต่อความเร็วสูงระหว่างส่วนประกอบหลักทั้งหมดรวมถึงส่วนหน้า RF, อินเทอร์เฟซโฮสต์ และหน่วยความจำ DDR3FPGA เริ่มต้นมี UHD ทั้งหมดสำหรับควบคุมการแปลงดาวน์คอนเวอร์ชั่นและการแปลงดิจิทัล การปรับความถี่อย่างละเอียด และบล็อกฟังก์ชัน DSP อื่นๆผู้ใช้สามารถใช้ประโยชน์จากพื้นที่ว่างของ Kintex-7 FPGA ที่มีทรัพยากรมากมาย รวมทั้งเฟรมเวิร์กการพัฒนา RFNoC ที่ได้รับการสนับสนุนจาก USRP เพื่อพัฒนาและใช้งานโมดูลการประมวลผล DSP ของตนเอง
ดิUSRP-LW 2944มีอินเทอร์เฟซความเร็วสูงให้เลือกหลากหลายบนแผงควบคุมของอุปกรณ์ พอร์ต Gigabit Ethernet เป็นหนึ่งในวิธีการเชื่อมต่อที่ง่ายที่สุดและใช้บ่อยที่สุดสำหรับแอปพลิเคชันที่มีแบนด์วิดท์ขยายและเวลาแฝงต่ำ เช่น การศึกษา PHY/MAC X310 มีบัสอินเทอร์เฟซ PCIe x4 ที่มีประสิทธิภาพสำหรับการดำเนินการที่กำหนดเมื่อแอปพลิเคชันใช้การบันทึกเครือข่ายหรือการประมวลผลแบบหลายโหนด พอร์ต 10 กิกะบิตจะเป็นตัวเลือกที่ดีที่สุด
ดิUSRP-LW 2944มีคุณสมบัติเพิ่มเติมมากมายที่จะช่วยแอปพลิเคชั่นไร้สายอื่นๆตัวอย่างเช่น ในการออกแบบ FPGA 1GB DDR3 บนเมนบอร์ดสามารถใช้เป็นบัฟเฟอร์ข้อมูลและจัดเก็บข้อมูลได้GPSDO ภายในที่เป็นตัวเลือกให้การอ้างอิงความถี่ที่มีความแม่นยำสูงเมื่อซิงโครไนซ์กับระบบ GPS โดยมีความล่าช้าในการซิงโครไนซ์น้อยกว่า 50nsอนุญาตให้ผู้ใช้ควบคุมส่วนประกอบภายนอก เช่น แอมพลิฟายเออร์และสวิตช์ผ่านอินเทอร์เฟซ GPIO รองรับอินพุต เช่น ทริกเกอร์เหตุการณ์ และสังเกตสัญญาณดีบักดิUSRP-LW 2940รวมถึงอะแดปเตอร์ JTAG ภายในที่ช่วยให้นักพัฒนาสามารถโหลดและดีบักอิมเมจ FPGA ใหม่ได้อย่างง่ายดาย
ผู้ติดต่อ: Mr. Chen
โทร: 18062514745
